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* Copyright (C) 2009-2018 Texas Instruments Incorporated - www.ti.com
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* Redistribution and use in source and binary forms, with or without
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#ifndef __PINMUX_H__
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#define PINMUX_ETPWM6_EQEPERR12 ((uint32)((uint32)0x1U << PINMUX_ETPWM6_SHIFT))
#define PINMUX_ETPWM6_EQEPERR1 ((uint32)((uint32)0x2U << PINMUX_ETPWM6_SHIFT))
#define PINMUX_ETPWM6_EQEPERR2 ((uint32)((uint32)0x4U << PINMUX_ETPWM6_SHIFT))
#define PINMUX_ETPWM7_EQEPERR12 ((uint32)((uint32)0x1U << PINMUX_ETPWM7_SHIFT))
#define PINMUX_ETPWM7_EQEPERR1 ((uint32)((uint32)0x2U << PINMUX_ETPWM7_SHIFT))
#define PINMUX_ETPWM7_EQEPERR2 ((uint32)((uint32)0x4U << PINMUX_ETPWM7_SHIFT))
#define PINMUX_ETPWM_TIME_BASE_SYNC_ON ((uint32)((uint32)0x2U << PINMUX_ETPWM_TIME_BASE_SYNC_SHIFT))
#define PINMUX_ETPWM_TBCLK_SYNC_ON ((uint32)((uint32)0x2U << PINMUX_ETPWM_TBCLK_SYNC_SHIFT))
#define PINMUX_ETPWM_TIME_BASE_SYNC_OFF ((uint32)((uint32)0x0 << PINMUX_ETPWM_TIME_BASE_SYNC_SHIFT))
#define PINMUX_ETPWM_TBCLK_SYNC_OFF ((uint32)((uint32)0x0 << PINMUX_ETPWM_TBCLK_SYNC_SHIFT))
#define PINMUX_TZ1_ASYNC ((uint32)((uint32)0x1U << PINMUX_TZ1_SHIFT))
#define PINMUX_TZ1_SYNC ((uint32)((uint32)0x2U << PINMUX_TZ1_SHIFT))
#define PINMUX_TZ1_FILTERED ((uint32)((uint32)0x4U << PINMUX_TZ1_SHIFT))
#define PINMUX_TZ2_ASYNC ((uint32)((uint32)0x1U << PINMUX_TZ2_SHIFT))
#define PINMUX_TZ2_SYNC ((uint32)((uint32)0x2U << PINMUX_TZ2_SHIFT))
#define PINMUX_TZ2_FILTERED ((uint32)((uint32)0x4U << PINMUX_TZ2_SHIFT))
#define PINMUX_TZ3_ASYNC ((uint32)((uint32)0x1U << PINMUX_TZ3_SHIFT))
#define PINMUX_TZ3_SYNC ((uint32)((uint32)0x2U << PINMUX_TZ3_SHIFT))
#define PINMUX_TZ3_FILTERED ((uint32)((uint32)0x4U << PINMUX_TZ3_SHIFT))
#define PINMUX_EPWM1SYNCI_ASYNC ((uint32)((uint32)0x1U << PINMUX_EPWM1SYNCI_SHIFT))
#define PINMUX_EPWM1SYNCI_SYNC ((uint32)((uint32)0x2U << PINMUX_EPWM1SYNCI_SHIFT))
#define PINMUX_EPWM1SYNCI_FILTERED ((uint32)((uint32)0x4U << PINMUX_EPWM1SYNCI_SHIFT))
typedef struct pinmux_config_reg
{
uint32 CONFIG_PINMMR0;
uint32 CONFIG_PINMMR1;
uint32 CONFIG_PINMMR2;
uint32 CONFIG_PINMMR3;
uint32 CONFIG_PINMMR4;
uint32 CONFIG_PINMMR5;
uint32 CONFIG_PINMMR6;
uint32 CONFIG_PINMMR7;
uint32 CONFIG_PINMMR8;
uint32 CONFIG_PINMMR9;
uint32 CONFIG_PINMMR10;
uint32 CONFIG_PINMMR11;
uint32 CONFIG_PINMMR12;
uint32 CONFIG_PINMMR13;
uint32 CONFIG_PINMMR14;
uint32 CONFIG_PINMMR15;
uint32 CONFIG_PINMMR16;
uint32 CONFIG_PINMMR17;
uint32 CONFIG_PINMMR18;
uint32 CONFIG_PINMMR19;
uint32 CONFIG_PINMMR20;
uint32 CONFIG_PINMMR21;
uint32 CONFIG_PINMMR22;
uint32 CONFIG_PINMMR23;
uint32 CONFIG_PINMMR24;
uint32 CONFIG_PINMMR25;
uint32 CONFIG_PINMMR26;
uint32 CONFIG_PINMMR27;
uint32 CONFIG_PINMMR28;
uint32 CONFIG_PINMMR29;
uint32 CONFIG_PINMMR30;
uint32 CONFIG_PINMMR31;
uint32 CONFIG_PINMMR32;
uint32 CONFIG_PINMMR33;
uint32 CONFIG_PINMMR34;
uint32 CONFIG_PINMMR35;
uint32 CONFIG_PINMMR36;
uint32 CONFIG_PINMMR37;
uint32 CONFIG_PINMMR38;
uint32 CONFIG_PINMMR39;
uint32 CONFIG_PINMMR40;
uint32 CONFIG_PINMMR41;
uint32 CONFIG_PINMMR42;
uint32 CONFIG_PINMMR43;
uint32 CONFIG_PINMMR44;
uint32 CONFIG_PINMMR45;
uint32 CONFIG_PINMMR46;
uint32 CONFIG_PINMMR47;
}pinmux_config_reg_t;
/**
* @defgroup IOMM IOMM
* @brief I/O Multiplexing and Control Module.
*
* The IOMM contains memory-mapped registers (MMR) that control device-specific multiplexed functions.
* The safety and diagnostic features of the IOMM are:
* - Kicker mechanism to protect the MMRs from accidental writes
* - Master-id checker to only allow the CPU to write to the MMRs
* - Error indication for access violations
*
* Related Files
* - reg_pinmux.h
* - pinmux.h
* - pinmux.c
* @addtogroup IOMM
* @{
*/
/** @fn void muxInit(void)
* @brief Initializes the PINMUX Driver
*
* This function initializes the PINMUX module and configures the selected
* pinmux settings as per the user selection in the GUI
*/
void muxInit(void);
void pinmuxGetConfigValue(pinmux_config_reg_t *config_reg, config_value_type_t type);
/* USER CODE BEGIN (0) */
/* USER CODE END */
/**@}*/
#ifdef __cplusplus
}
#endif /*extern "C" */
#endif
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